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第1篇 數(shù)字集成電路工程師崗位職責(zé)數(shù)字集成電路工程師職責(zé)任職要求
數(shù)字集成電路工程師崗位職責(zé)
數(shù)字集成電路驗證工程師 廣東高云半導(dǎo)體科技股份有限公司 山東高云半導(dǎo)體科技有限公司職位描述:
1) 根據(jù)fpga芯片中各功能模塊如serdes等要求，書寫驗證方案，制定驗證計劃。
2) 維護和搭建驗證環(huán)境，執(zhí)行/調(diào)試/分析回歸驗證和覆蓋率收集，以及開發(fā)腳本提升驗證效率。
崗位要求:
1) 大學(xué)本科及以上學(xué)歷，電子工程、通信、微電子或相關(guān)專業(yè)。
2) 熟練使用verilog， systemverilog，熟悉uvm仿真環(huán)境以及面向?qū)ο蟮脑O(shè)計方法。
3) 熟悉數(shù)字集成電路前端后端仿真驗證。
4) 熟悉腳本語言的使用，如perl，python， shell， makefile等
5) 優(yōu)先考慮具有serdes 協(xié)議驗證經(jīng)驗。
第2篇 集成電路ic工程師崗位職責(zé)集成電路ic工程師職責(zé)任職要求
集成電路ic工程師崗位職責(zé)
模擬集成電路ic設(shè)計工程師 模擬電路設(shè)計應(yīng)用工程師
4年以上模擬集成ic相關(guān)工作經(jīng)驗
本科以上相關(guān)專業(yè)的學(xué)歷 模擬電路設(shè)計應(yīng)用工程師
4年以上模擬集成ic相關(guān)工作經(jīng)驗
本科以上相關(guān)專業(yè)的學(xué)歷
第3篇 數(shù)字集成電路設(shè)計工程師崗位職責(zé)
數(shù)字集成電路設(shè)計工程師 深圳捷謄技術(shù)有限公司 深圳捷謄技術(shù)有限公司,捷謄技術(shù),捷謄 職責(zé)描述:
1、負(fù)責(zé)算法到rtl的代碼實現(xiàn);
2、負(fù)責(zé)rtl代碼在fpga平臺的初步驗證;
任職要求:
1、微電子與固體電子學(xué)專業(yè)、計算機相關(guān)專業(yè),本科以上學(xué)歷;
2、1年以上使用verilog語言進行電路設(shè)計經(jīng)驗,掌握vcs, design compiler, prime time等eda工具;
3、熟悉asic設(shè)計開發(fā)流程,具有功能驗證,時序分析的相關(guān)經(jīng)驗;
4、熟悉altera/_ilin_ fpga及其設(shè)計開發(fā)工具,能夠?qū)?shù)字代碼進行fpga的驗證;
5、加分項:熟悉pcie接口協(xié)議,ecc算法。
第4篇 集成電路ic工程師崗位職責(zé)
(初高級)集成電路驗證ic dv工程師 綠芯半導(dǎo)體(廈門)有限公司 綠芯半導(dǎo)體(廈門)有限公司,綠芯 job description and responsibilities:
1) define the verification spec and plan basing on design spec
2) setup and maintain the simulation environment.
3) work with ic design engineers to complete the test vectors
4) generate the product test pattern and test pattern support
6) front-end design
職位描述和職責(zé):
1) 根據(jù)設(shè)計 spec 定義 驗證 spec,定義驗證計劃
2) 建立和維護整個項目的設(shè)計仿真環(huán)境
3) 與設(shè)計工程師一起完成整個項目驗證
4) 生成產(chǎn)品的測試向量并與測試工程師完成測試向量的調(diào)試
key competency requirements:
1) familiar with system verilog or system c or e language, have the transaction level ic uvm verification methodology e_perience.
2) familiar with the uni_/linu_ os, and ic database setup
3) familiar with perl and shell
4) familiar with popular front-end design language and ic eda tools, for e_ample: cadence: nc verilog, irun, specman , hal
5) solid knowledge on atpg and test pattern.
7) good communication and team work ability.
主要工作能力要求:
1) 熟悉system verilog (或 system c 或 e langurage), 要有真正的事務(wù)級驗證工作經(jīng)驗,能獨立搭建事務(wù)級驗證平臺
2) 熟悉uni_/linu_ 操作系統(tǒng)和ic設(shè)計環(huán)境
3) 熟悉 perl 和 shell語言
4) 熟悉常用的前端設(shè)計語言和工具 (verilog/vhdl, nc-verilog, hal)
5) 了解atpg和測試向量知識
6) 良好的溝通能力和團隊合作能力
education & e_perience required:
3+ years e_perience for master 5+ e_perience years for bachelor
碩士3年以上工作經(jīng)驗,本科5年以上工作經(jīng)驗,條件優(yōu)秀者可適當(dāng)放寬
第5篇 集成電路應(yīng)用工程師崗位職責(zé)
集成電路應(yīng)用工程師 光大芯業(yè) 紹興光大芯業(yè)微電子有限公司,光大芯業(yè),紹興光大芯業(yè),光大芯業(yè) 職責(zé)描述:
1、負(fù)責(zé)芯片的驗證和系統(tǒng)驗證。
2、產(chǎn)品的推廣和定義。
3、協(xié)助fae解決客戶產(chǎn)品應(yīng)用問題。
任職資格:
1、微電子、電力電子、電子工程、電機等相關(guān)專業(yè)畢業(yè)。
2、2年以上電源設(shè)計或應(yīng)用經(jīng)驗,優(yōu)秀應(yīng)屆畢業(yè)生也可。
3、有單片機和fpga經(jīng)驗優(yōu)先。
4、本科及以上學(xué)歷。
第6篇 數(shù)字集成電路工程師崗位職責(zé)
數(shù)字集成電路設(shè)計(工程師) 深圳市紐瑞芯科技有限公司 深圳市紐瑞芯科技有限公司,紐瑞芯 職責(zé)描述:
1. 參與數(shù)字集成電路模塊設(shè)計和驗證工作;
2. 根據(jù)模塊規(guī)格要求,完成數(shù)字電路模塊詳細(xì)設(shè)計;負(fù)責(zé)所設(shè)計模塊基本功能驗證;
3. 負(fù)責(zé)前端設(shè)計工作,包括電路綜合、時序檢查、形式驗證等;
4. 對模塊集成、驗證、測試和調(diào)試提供技術(shù)支持。
任職要求:
1. 微電子專業(yè)本科以上學(xué)歷,有成功的數(shù)字集成電路設(shè)計開發(fā)經(jīng)歷優(yōu)先;
2. 理解數(shù)字集成電路的設(shè)計驗證技術(shù)和流程;
3. 掌握數(shù)字信號處理基本原理及數(shù)字實現(xiàn)方法,包括數(shù)字濾波器,采樣變換,調(diào)制編碼等;
4. 熟練使用linu_/uni_操作系統(tǒng),熟悉vhdl/verilog等工具語言;
5. 熟悉數(shù)字ic設(shè)計流程,熟練掌握synopsys或cadence eda工具;
6. 通信協(xié)議和標(biāo)準(zhǔn)有一定的了解優(yōu)先;
7. 有數(shù)字驗證,dft或數(shù)字后端設(shè)計經(jīng)驗的優(yōu)先;
8. 良好的團隊合作精神及技術(shù)學(xué)習(xí)能力。具備較強動手能力。
第7篇 集成電路設(shè)計工程師崗位職責(zé)
模擬集成電路設(shè)計工程師 南京華訊方舟通信設(shè)備有限公司 南京華訊方舟通信設(shè)備有限公司,南京華訊,南京華訊方舟,南京華訊 1、根據(jù)設(shè)計指標(biāo)設(shè)計bg、ldo、opa、comparator等基本電路;
2、根據(jù)系統(tǒng)要求參與設(shè)計pll、adc、dac、filter、vga等系統(tǒng);
3、根據(jù)電路要求配合版圖工程師完成相應(yīng)版圖的設(shè)計;
4、根據(jù)電路設(shè)計結(jié)果完成設(shè)計文檔的編寫以及制定相應(yīng)的測試計劃;
5、配合測試工程師完成相應(yīng)模塊的測試,并根據(jù)測試數(shù)據(jù)進行性能評估以及問題分析;
職位要求:
1、本科以上微電子、電子工程、電子信息等專業(yè);
2、具備兩年以上模擬集成電路設(shè)計經(jīng)驗;
3、對運放、比較器、帶隙基準(zhǔn)等基本模塊的原理有比較深刻的認(rèn)識;
4、有pll/adc/dac/filter/ldo等模塊設(shè)計經(jīng)驗優(yōu)先;
5、熟悉使用cadence virtuoso集成電路設(shè)計平臺;
6、良好的團隊合作精神,工作敬業(yè)負(fù)責(zé)。
第8篇 集成電路前端設(shè)計工程師崗位職責(zé)
集成電路前端(數(shù)字)設(shè)計工程師 廣芯微電子(廣州)股份有限公司 廣芯微電子(廣州)股份有限公司,廣芯微電子,廣芯 職責(zé)描述:
1. 參與產(chǎn)品架構(gòu)設(shè)計
2. 按照產(chǎn)品定義完成ip設(shè)計及系統(tǒng)設(shè)計
3. 配合fpga進行系統(tǒng)調(diào)試
4. 參與數(shù)字電路的仿真驗證
5. 參與芯片的數(shù)字流程
6. 編寫ip及產(chǎn)品文檔
任職要求:
1. 電子工程,計算機或微電子等專業(yè),本科以上學(xué)歷
2. 在數(shù)字設(shè)計領(lǐng)域有2年以上工作經(jīng)驗
3. 熟悉verilog hdl語言,熟悉arm,amba總線及常用ip的原理
4. 熟悉常用的eda工具,理解芯片時序以及測試概念
5. 具有arm或者mcu項目經(jīng)驗者優(yōu)先
6. 具有團隊精神,責(zé)任感,積極主動,溝通能力強
第9篇 集成電路測試工程師崗位職責(zé)
高速集成電路芯片測試工程師 成都天朗電子科技有限公司 成都德曜電子科技有限公司,德曜 職責(zé)描述:
1. 根據(jù)產(chǎn)品spec對芯片的功能及性能進行測試,制定測試及測試計劃;
2. 搭建芯片測試平臺,進行芯片產(chǎn)品測試方案,測試工具及測試用例的準(zhǔn)備;
3. 負(fù)責(zé)芯片功能,性能及可靠性的測試所需的軟件及硬件的設(shè)計及調(diào)試;
4. 協(xié)助芯片設(shè)計工程師對芯片問題進行分析定位,并進行解決方案的有效性驗證。
任職要求:
1. 計算機,通訊,電子類專業(yè),本科以上學(xué)歷,2年以上高速電路系統(tǒng)測試經(jīng)驗;
2. 熟練掌握高速及射頻芯片測試流程,熟悉s參數(shù),頻譜,眼圖,噪聲等測試方法;
3. 熟練使用pna, 頻譜儀,bert, 高速示波器等高頻測試儀器;
4. 具備芯片測試用控制軟件的編程能力(vb, python)及測試硬件的設(shè)計能;
5. 具有良好的組織學(xué)習(xí)能力、及溝通協(xié)調(diào)能力。
第10篇 集成電路工程師崗位職責(zé)
高級集成電路工程師 二、崗位職責(zé):
1、負(fù)責(zé)mems芯片cmos集成電路的設(shè)計、開發(fā);
2、參與mems芯片cmos集成電路規(guī)范的制定;
3、參與對集成電路的測試和試錯;
4、參與和協(xié)助與外協(xié)設(shè)計公司的溝通和合作;
5、提供對版圖工程師的指導(dǎo);
6、參與和ic代工廠的對接和代工服務(wù);
7、參與跟芯片控制和驅(qū)動系統(tǒng)的對接。
三、任職資格說明:
1、電子,集成電路自動化控制專業(yè),碩士以上學(xué)歷;
2、5年以上系統(tǒng)設(shè)計的的相關(guān)經(jīng)驗,了解驅(qū)動電路,掌握和熟悉系統(tǒng)的設(shè)計和制作,有顯示驅(qū)動asic和fpga經(jīng)驗者優(yōu)先;
3、有良好的電子系統(tǒng)基礎(chǔ),團隊合作精神,溝通能力,樂于學(xué)習(xí),責(zé)任心強;
4、985、211院校優(yōu)先。 二、崗位職責(zé):
1、負(fù)責(zé)mems芯片cmos集成電路的設(shè)計、開發(fā);
2、參與mems芯片cmos集成電路規(guī)范的制定;
3、參與對集成電路的測試和試錯;
4、參與和協(xié)助與外協(xié)設(shè)計公司的溝通和合作;
5、提供對版圖工程師的指導(dǎo);
6、參與和ic代工廠的對接和代工服務(wù);
7、參與跟芯片控制和驅(qū)動系統(tǒng)的對接。
三、任職資格說明:
1、電子,集成電路自動化控制專業(yè),碩士以上學(xué)歷;
2、5年以上系統(tǒng)設(shè)計的的相關(guān)經(jīng)驗,了解驅(qū)動電路,掌握和熟悉系統(tǒng)的設(shè)計和制作,有顯示驅(qū)動asic和fpga經(jīng)驗者優(yōu)先;
3、有良好的電子系統(tǒng)基礎(chǔ),團隊合作精神,溝通能力,樂于學(xué)習(xí),責(zé)任心強;
4、985、211院校優(yōu)先。
第11篇 射頻集成電路設(shè)計工程師崗位職責(zé)
射頻集成電路設(shè)計工程師 北京百瑞互聯(lián)技術(shù)有限公司 北京百瑞互聯(lián)技術(shù)有限公司,百瑞 崗位職責(zé):
1 基于cmos工藝的射頻收發(fā)芯片的電路和系統(tǒng)設(shè)計,制定各模塊性能指標(biāo)和實現(xiàn)方案;
2 獨立進行射頻電路模塊的設(shè)計,其中包括電路結(jié)構(gòu)的確立、行為級和電路級的仿真、電路的實現(xiàn)和芯片的測試,并指導(dǎo)系統(tǒng)級射頻應(yīng)用。
3根據(jù)規(guī)范設(shè)計射頻集成電路諸如lna、 mi_er、pll、 vco, filter, vga,ad da和pa等
4.根據(jù)系統(tǒng)要求將各個功能模塊集成為soc系統(tǒng)
5.根據(jù)電路要求指導(dǎo)版圖工程師進行版圖設(shè)計
6根據(jù)設(shè)計結(jié)果完成設(shè)計文檔和測試計劃
7芯片功能模塊和系統(tǒng)測試、性能評估和問題分析
任職要求:
1.微電子學(xué),半導(dǎo)體或相關(guān)專業(yè)碩士及以上學(xué)歷
2.有l(wèi)na、 mi_er、pll、vco、pa, filter,vga, ad,da等模塊的設(shè)計經(jīng)驗優(yōu)先
3.熟練掌握電路原理基礎(chǔ)知識,了解反饋理論及其應(yīng)用
4.能正確分析諸如運放,功放,混頻器等集成單元電路
5.熟練使用cadence 集成電路設(shè)計環(huán)境
6.會用電路仿真軟件建立正確的仿真測試平臺并正確分析電路仿真結(jié)果
7.良好的團隊合作精神,工作敬業(yè)負(fù)責(zé)
第12篇 集成電路驗證工程師崗位職責(zé)
集成電路前端(數(shù)字)驗證工程師 廣芯微電子(廣州)股份有限公司 廣芯微電子(廣州)股份有限公司,廣芯微電子,廣芯 職責(zé)描述:
1. 與芯片設(shè)計工程師溝通,撰寫完整的ip驗證和芯片級驗證的測試計劃
2. 負(fù)責(zé)芯片測試環(huán)境搭建
3. 使用system verilog搭建uvm驗證環(huán)境。能進行隨機性測試和回歸測試。
4. 參與fpga系統(tǒng)驗證
任職要求:
1. 電子工程,計算機或微電子等專業(yè),本科以上學(xué)歷
2. 在數(shù)字設(shè)計驗證領(lǐng)域有2年以上工作經(jīng)驗
3. 熟悉ip模塊以及芯片級測試計劃的撰寫
4. 熟悉verilog/c/c++
5. 熟悉uvm驗證方法學(xué),熟悉使用system verilog。
6. 具有芯片流片經(jīng)驗者優(yōu)先
7. 有低功耗驗證者優(yōu)先
8. 具有團隊精神,責(zé)任感,積極主動,溝通能力強
第13篇 集成電路設(shè)計工程師崗位職責(zé)集成電路設(shè)計工程師職責(zé)任職要求
集成電路設(shè)計工程師崗位職責(zé)
高級集成電路設(shè)計工程師 主要職責(zé)
1. 與軟件工程師和固件工程師設(shè)計團隊關(guān)于先進nvm控制系統(tǒng)設(shè)計進行密切合作
2. 負(fù)責(zé)對存儲soc的模塊進行性能規(guī)范，微架構(gòu)定義，以及設(shè)計
3. 通過fpga模擬設(shè)計以驗證和調(diào)試硬件達到運行目標(biāo)
職位要求:
學(xué)歷
必須統(tǒng)招本科以上學(xué)歷
其他項
三年及以上復(fù)雜soc設(shè)計經(jīng)驗
fpga設(shè)計及相關(guān)工具運用工作經(jīng)驗
熟悉嵌入式處理器子系統(tǒng)設(shè)計 主要職責(zé)
1. 與軟件工程師和固件工程師設(shè)計團隊關(guān)于先進nvm控制系統(tǒng)設(shè)計進行密切合作
2. 負(fù)責(zé)對存儲soc的模塊進行性能規(guī)范，微架構(gòu)定義，以及設(shè)計
3. 通過fpga模擬設(shè)計以驗證和調(diào)試硬件達到運行目標(biāo)
職位要求:
學(xué)歷
必須統(tǒng)招本科以上學(xué)歷
其他項
三年及以上復(fù)雜soc設(shè)計經(jīng)驗
fpga設(shè)計及相關(guān)工具運用工作經(jīng)驗
熟悉嵌入式處理器子系統(tǒng)設(shè)計
第14篇 集成電路版圖工程師崗位職責(zé)
集成電路版圖工程師 上海漢締醫(yī)療設(shè)備有限公司 上海漢締醫(yī)療設(shè)備有限公司,漢締 崗位職責(zé):
1、 負(fù)責(zé)根據(jù)designer提供的schematic創(chuàng)建模擬與混合信號ic晶體管級版圖設(shè)計;
2、 通過drc和lvs對版圖進行驗證和優(yōu)化;
3、 與designer精密合作與溝通,對版圖的結(jié)構(gòu)和布局有準(zhǔn)確性地理解。
任職要求:
1、 微電子等相關(guān)專業(yè),本科學(xué)歷;
2、 熟練掌握版圖設(shè)計工具cadence virtuoso/laker設(shè)計流程,及版圖驗證drc和lvs工作使用流程;
3、 能夠讀懂foundry提供的design rule等文件;
4、 有cmos圖像傳感器設(shè)計版圖,了解ic工藝制作流程者優(yōu)先考慮;
5、 態(tài)度積極主動,有團隊合作精神。
第15篇 半導(dǎo)體集成電路工程師崗位職責(zé)
ic layout design engineer 半導(dǎo)體集成電路版圖設(shè)計工程師 description as an ic layout design engineer at micron's shanghai design center, you will work in a highly innovative and motivated design team using state of the art memory technologies to advance dram memory design. as part of a multi-disciplinary team, you will contribute to physical layout floor plan of various memory chip circuit blocks, and perform block level layout, lvs/drc verification and using other cad tools to check layout. of course you will also work closely with micron's various design teams in us and other countries and leverage vast resources available throughout micron’s global sites. additionally, you will perform verification (lvs/drc etc) of layout to the full-chip level, and assist in project tape out. requirement -college degree (or above) in electrical engineering or other related engineering field. -3 to 5 years of ic custom layout working e_perience (more e_perienced engineers highly welcome). -proficiency with cadence oa and calibre verification tools desirable. -understanding of basic cmos circuits is a plus. -understanding of dram/flash architecture or previous memory layout e_perience is a plus. -english language skill in writing and speaking is a plus. -no fresh graduates will be considered. education college degree (or above) in electrical engineering or other related engineering field.
第16篇 模擬集成電路設(shè)計工程師崗位職責(zé)任職要求
模擬集成電路設(shè)計工程師崗位職責(zé)
模擬集成電路ic設(shè)計工程師 芯片行業(yè)3年以上同崗位經(jīng)驗;芯片行業(yè)3年以上同崗位經(jīng)驗;芯片行業(yè)3年以上同崗位經(jīng)驗
本科以上學(xué)歷，微電子行業(yè)優(yōu)先 芯片行業(yè)3年以上同崗位經(jīng)驗;芯片行業(yè)3年以上同崗位經(jīng)驗;芯片行業(yè)3年以上同崗位經(jīng)驗
本科以上學(xué)歷，微電子行業(yè)優(yōu)先
模擬集成電路設(shè)計工程師崗位
